1.基于BASYS3板子，有如下代码：
module top(
input clk,
input rst,
output test_clk
);
parameter DIV_CNT = 2;
reg clk25M;
reg [31:0] cnt = 0;
always@(posedge clk)begin
if (cnt==DIV_CNT-1)
begin
clk25M <= ~clk25M;
cnt <= 0;
end
else
begin
cnt <= cnt + 1'b1;
end
end
assign test_clk = rst ? 1'b0 : clk25M;
管脚配置XDC文件内容如下：
set_property PACKAGE_PIN W5 [get_ports clk]
set_property IOSTANDARD LVCMOS33 [get_ports clk]
set_property PACKAGE_PIN V17 [get_ports rst]
set_property IOSTANDARD LVCMOS33 [get_ports rst]
set_property PACKAGE_PIN L1 [get_ports test_clk]
set_property IOSTANDARD LVCMOS33 [get_ports test_clk]
2.占击左侧Run Synthesis，综合
3.完成之后，再点击 Open Synthesized Design，打开之后，点Tools下的Set Up Debug...
如下
4.选择Find Nets to Add...
5.点OK
6.选中想要观察的信号，点OK
7.出现红色，在红色地方右键。
8.选择Select Clock Domain
9.选择ALL_CLOCK，然后选择clk_IBUF或clk_IBUF_BUFG
10.选择合适的采集深度，1024通常够用
11.Finish
12.点击左侧的Generate Bitstream
13.完成后，点Open Hardware Manager
14.将板子连接到电脑上，然后Open Target -> Auto Connect
15.在xc7a35t上面，右键->Program Device...
16.Program
17.点击Trigger
18.会自动弹出波形
19.此时，只有test_clk信号，没有rst信号。在Debug Probes区域中，rst_IBUF上右键
20.Add Probes to Wave Form
21.即可看到rst也在波形中了，添加其它信号类似
22.鼠标点住rst_IBUF，拖拽到图中区域放开鼠标
23.rst_IBUF信号会出现在框中
24.点开Compare Value下拉菜单，设置如下，点击OK
25.把BASYS3板子上的SW0，拔到上面。点击Run Trigger按钮
26.注意到这里应该显示Wait...
27.此时，在板子上，把SW0拔下来。注意到，这里会一闪而过Full，然后又显示Idle。如果没观察到，可以从25步骤再重来
28.再打开波形，如下图
29.回到这个界面，将Trigger Position 设置为500。再重复24-28步骤。然后再观察波形中，第500个周期，波形前后数据的变化
