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    SystemVerilog高效仿真技巧

    本文首发于微信公众号“芯片学堂”,作者JKZHAN 做动态仿真验证通常会遇到要等待仿真结果的情况,特别是在调试某个测试用例的时候。很多时候,工程师们会自然地认为仿真速度大部分...

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    SystemVerilog面向对象

    本文首发于微信公众号“芯片学堂”,作者JKZHAN 分享笔记,一张大图涵盖绝大部分SystemVerilog OOP干货! 面向对象编程(OOP)中涉及到的各类特性,比如多态...

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    SystemVerilog多线程

    本文首发于微信公众号“芯片学堂”,作者JKZHAN 多线程、并发、并行计算等这些概念我们在很多计算机相关的领域都会听到。具体去看,并行计算是一个非常广泛的课题,涵盖了计算机体...

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    SystemVerilog随机方法

    本文首发于微信公众号“芯片学堂”,作者JKZHAN 我习惯将验证空间理解为:验证中原则上需要覆盖的芯片所有有可能出现的工作状态的集合。为了探索这片广袤的验证空间,验证的时候搞...

  • SystemVerilog随机约束

    本文首发于微信公众号“芯片学堂”,作者JKZHAN 上一篇文章《暗藏玄机的SV随机化》介绍了SystemVerilog的各种随机化方法,本文将在其基础上引入SystemVer...

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    Python时间处理模块的常用选择:八大模块

    时间数据 时间格式是数据类型中基础也不容忽视的一类。不像整数那样大道至简也不像字符串那样包罗万象,却独有魅力,时间数据本身除了加减、比较运算外,也有下周、去年、时区等更专项的...

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    SystemVerilog结构体

    本文首发于微信公众号“芯片学堂”,作者JKZHAN 在上一篇文章《SystemVerilog枚举》中,介绍了枚举类型的本质和使用语法。本文接着介绍SV中同样不可忽略的结构体(...

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    SystemVerilog枚举

    本文首发于微信公众号“芯片学堂”,作者JKZHAN 对于刚接触SV的小伙伴来说,SV有几种不怎么能引起关注,但在实际工作中又经常会用到的数据类型。它们就是枚举(enumera...

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